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DM8148只使用一个DDR的控制器会对整个系统有什么影响

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问答对人有帮助，内容完整，我也想知道答案 0 你好！我最近在做DM8168的相关项目开发，情况是这样：项目上要DM8168同时进行4路1080P高清视频处理，由于一些限制条件，硬件板卡设计只能用两片16位的DDR3接在DM8168的一个DDR3控制器上但EVM的设计是两个DDR3都使用了。所以我想问的是，我这样设计硬件会对整个板卡处理视频的能力有多大的影响，是不是这样设计的话系统访问DDR的速度就变成了原来的一半？麻烦各位大师给小弟解答一个，谢谢！ 0
2018-6-22 06:08:22　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 新星之火12138 该类别下有 58 个回答。邀请回答 heks 该类别下有 57 个回答。邀请回答普罗旺斯的薰衣草该类别下有 55 个回答。邀请回答 lksas 该类别下有 46 个回答。邀请回答 wang21cj 该类别下有 45 个回答。邀请回答 chm5 该类别下有 45 个回答。邀请回答 hgimtk 该类别下有 44 个回答。邀请回答 fdhsfagd 该类别下有 42 个回答。邀请回答 huzp_bbs 该类别下有 41 个回答。邀请回答 ggfx 该类别下有 41 个回答。邀请回答颜刚YanG 该类别下有 40 个回答。邀请回答 zhhx1985 该类别下有 40 个回答。邀请回答 zhouxk 该类别下有 39 个回答。邀请回答 K_Ming 该类别下有 39 个回答。邀请回答潘涛12345 该类别下有 39 个回答。邀请回答 kghfh 该类别下有 39 个回答。邀请回答站着幻想该类别下有 38 个回答。邀请回答 kingnet6688 该类别下有 38 个回答。邀请回答 lifei639156 该类别下有 38 个回答，其中被选为最佳答案 1 次。邀请回答 msvdsufsdf 该类别下有 38 个回答。邀请回答举报胡楚翘相关推荐 • 请教一下DM8148的DDR控制器支持读写平衡吗，没找到描述，用fly-by拓扑，还是T型？ 1816 • DM8148 最少可贴几片内存？ 1426 • 从哪里可以获得DM8148芯片使用DDR3的参考设计？ 1477 • DM8148 cortex-A8 1-GHz的问题求助 1168 • DM8148的多核通信，在CCS5.2上新建DM8148的ipc工程，用的是IPC and I/O Example 里面的例子程序，在编译时出现错误是什么原因？ 2816 • DM8148的uboot可不可以直接用于DM8127？ 1539 • 如何理解DM8148的HD Video Coprocessor Subsystem和Media Controller Subsystem中的HDVICP2 1982 • 请问DM8148 开发板具体哪天正式推出？在此之前能否得到相关User Guide文档？ 1648 • 请问一下dm8127/dm8148 上有没有CCS测试的BSL工具啊？有下载链接吗？ 2112 • DM8148两路标清视频同时采集 2450 11个回答

答案对人有帮助，有参考价值 0 补充一下，主要的区别是我的板卡上只用了一个DDR控制器，而EVM板上用的是两个DDR控制器。

2018-6-22 06:16:11 评论举报胡楚翘

答案对人有帮助，有参考价值 0 asd002 发表于 2018-6-22 06:16 补充一下，主要的区别是我的板卡上只用了一个DDR控制器，而EVM板上用的是两个DDR控制器。 - DM8168 还是 DM8148 ? - 一个DDR内存控制器不用的话，简言之你系统的DDR数据吞吐能力就是原来的一般了。

2018-6-22 06:34:08 评论举报吴立节

答案对人有帮助，有参考价值 0 你好；这个是有影响的，首先就是你DDR的带宽只有原来的一半了，memory 也只有小了；在你后期处理的时候，可能会由于的DDR带宽的问题，导致在视频处理的时候，帧率上不去，这个需要实测或者是理论上面进行计算分析

2018-6-22 06:49:07 评论举报葛睿洁

答案对人有帮助，有参考价值 0 sunsiyi92 发表于 2018-6-22 06:34 - DM8168 还是 DM8148 ? - 一个DDR内存控制器不用的话，简言之你系统的DDR数据吞吐能力就是原来的一般了。 - 系统中有很多地方会需要用到DDR的读写操作，就比如M3，VPSS，HDVICP之间的数据的传递。 - 系统具体需要的DDR吞吐取决于你的用例。以你目前提供的信息还不足以判断。

2018-6-22 06:57:09 评论举报吴立节

答案对人有帮助，有参考价值 0 sunsiyi92 发表于 2018-6-22 06:57 - 系统中有很多地方会需要用到DDR的读写操作，就比如M3，VPSS，HDVICP之间的数据的传递。 - 系统具体需要的DDR吞吐取决于你的用例。以你目前提供的信息还不足以判断。 - 是否已经有使用了2个DDR控制器的板子能够跑你目前的用例，一个简单的验证办法是将现有的板子DDR降频一半使用。 - 你是因为PCB板子面积不够才考虑缩减DDR颗粒个数？可以考虑用Mirror的方式，在top/bot层对着贴DDR，这样可以节省PCB布板面积。相应的，PCB层数通常需要8层或以上。

2018-6-22 07:08:49 评论举报吴立节

答案对人有帮助，有参考价值 0 sunsiyi92 发表于 2018-6-22 06:57 - 系统中有很多地方会需要用到DDR的读写操作，就比如M3，VPSS，HDVICP之间的数据的传递。 - 系统具体需要的DDR吞吐取决于你的用例。以你目前提供的信息还不足以判断。我的应用场景是DM8168芯片同时采集4路1080P的视频源，然后进行进行H264编码，编码完成后通过RTSP进行网络发送。

2018-6-22 07:17:34 评论举报胡楚翘

答案对人有帮助，有参考价值 0 asd002 发表于 2018-6-22 07:17 我的应用场景是DM8168芯片同时采集4路1080P的视频源，然后进行进行H264编码，编码完成后通过RTSP进行网络发送。补充一下，采集的视频源是1080P 30帧，还想请问一下，有没有相关的文档或工具可以计算我的这种应用场景需要多大的DDR3吞吐量？

2018-6-22 07:31:31 评论举报胡楚翘

答案对人有帮助，有参考价值 0 sunsiyi92 发表于 2018-6-22 07:08 - 是否已经有使用了2个DDR控制器的板子能够跑你目前的用例，一个简单的验证办法是将现有的板子DDR降频一半使用。 - 你是因为PCB板子面积不够才考虑缩减DDR颗粒个数？可以考虑用Mirror的方式，在top/bot层对着贴DDR，这样可以节省PCB布板面积。相应的，PCB层数通常需要8层或以上。 ... 我的应用场景是：DM8168进行4路1080P30的视频采集，H264编码，RTSP/RTP发送编码后的视频。还有我想问一下，有没有相关的文档或工具可以计算我的这个应用场景DDR#需要多大的吞吐量？谢谢！

2018-6-22 07:38:40 评论举报胡楚翘

答案对人有帮助，有参考价值 0 asd002 发表于 2018-6-22 07:38 我的应用场景是：DM8168进行4路1080P30的视频采集，H264编码，RTSP/RTP发送编码后的视频。还有我想问一下，有没有相关的文档或工具可以计算我的这个应用场景DDR#需要多大的吞吐量？谢谢！刚才简单的估算了一下，4路1080P30采集+编码，处理，32bit DDR，主频如果是800M，是够处理过来，大概消耗DDR带宽的80%；这个只是性能估算，最好是在EVM板子上面降频实际测试；如果DDR工作在1600MHz，应当是没有问题的（只做采集编码，不考虑其他的SC、DEI等处理）

2018-6-22 07:48:23 评论举报葛睿洁

答案对人有帮助，有参考价值 0 Greatwayer 发表于 2018-6-22 07:48 刚才简单的估算了一下，4路1080P30采集+编码，处理，32bit DDR，主频如果是800M，是够处理过来，大概消耗DDR带宽的80%；这个只是性能估算，最好是在EVM板子上面降频实际测试；如果DDR工作在1600MHz，应当是没有问题的（只做采集编码，不考虑其他的SC、DEI等处理） ... 感谢你的回答，我还有几个问题想请教下你： 1. 这个估算有什么计算公式或相关的文档，主要是有估算相关的文档的话在和客户进行方案评审时可作为用力的凭证。 2.如果实现没有问题，那使用一个DDR控制器，软件上要怎么配置（如：DMM，DDR控制器等），有没有参考例程，还有什么要注意的？ 3. 在软件上我们采用了Ram disk 的技术，请问这个对DDR3的使用和整个系统有怎样的影响？

2018-6-22 07:56:05 评论举报胡楚翘

答案对人有帮助，有参考价值 0 asd002 发表于 2018-6-22 07:56 感谢你的回答，我还有几个问题想请教下你： 1. 这个估算有什么计算公式或相关的文档，主要是有估算相关的文档的话在和客户进行方案评审时可作为用力的凭证。 2.如果实现没有问题，那使用一个DDR控制器，软件上要怎么配置（如：DMM，DDR控制器等），有没有参考例程，还有什么要注意的？ http://processors.wiki.ti.com/index.php/TI814x-DDR3-Init-U-Boot#FAQ 这里有个DM8148的Single EMIF patch dvr_rdkmcfwsrc_bios6cfgti814xconfig_512M.bld 参考以下文档： http://processors.wiki.ti.com/index.php/EZSDK_Memory_Map#Step_1:_Update_LISA_Registers

2018-6-22 08:01:16 评论举报吴立节

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