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本帖最后由 一只耳朵怪 于 2018-6-25 11:01 编辑
你好! 我目前正在实现6657DSP 评估板与xilinx kintex7 FPGA之间的PCIE连接,其中DSP作为Root Complex,FPGA作为End point。软件环境为CCS5.3。DSP上采用CCS5.3提供的关于pcie的例子工程(见附件)。FPGA端也采用xilinx公司提供的例程。 |
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4个回答
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收发数据时需要配置好in/out bound address transplation即收发地址映射关系,在发送时DSP侧想PCIe base address中写memory,PCIe硬件得到地址后会进行地址转换成PCIe总线上的地址,对端接收到地址后会进行地址转换映射到内部相应地址,之后把数据收下来。建议看一下PCIe的手册确认地址映射配置。
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zbb9612 发表于 2018-6-25 05:21 你好! 问题已经解决,谢谢! 还有一个问题:现在从FPGA上抓取的信号分析,DSP发送的一个数据帧(memory write TLP)只携带一个数据,即例程中那个发送的for循环,要发送40个TLP。技术文档中说明一个数据帧的最大载荷是128字节,那么该如何设置呢,使得载荷为128字节?是设置那个寄存器? |
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zbb9612 发表于 2018-6-25 05:21 你好,谢谢!问题已经解决! 还有一个问题:example.c发送出来的数据帧TLP的载荷仅为1DW,如何设置使得载荷为128字节?设置哪个寄存器呢? 谢谢! |
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lzongpuliu 发表于 2018-6-25 05:46 请问现在dsp端可以读取到FPGA的数据了吗? |
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