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一直都在用ADI的芯片
目前项目里面用到AD7175-2(SigmadetlaADC)利用FPGA控制 请问其中CS管脚如果置高后时哦能干的事钟还在 影不影响读出数据的结果,我目前用的是单通道,时钟个数要求比较严格 但是目前程序没改通,只是刚好在cs低电平宽度内保证了正确的时钟个数 请问这样能不能正常使用啊 最后 请问你们ADI有没有控制AD7175-2的verilog语言啊 能不能共享你们的控制程序 谢谢@@@ |
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CS为高时,DOUT为三态,不影响其他数据读出结果
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