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我正在使用xilinx V5 XC5VSX50T板,我不得不动态更改DCM频率。 我在网上查了一下,文档说我们可以使用drp模块(动态重配置端口)来改变DCM的乘法/除法值。 我想知道这个DRP模块是IP核还是xilinx原语? 我怎样才能在我的设计中实例化它? 我是否必须通过IP向导或其他方式将其添加到我的设计中? DCM DRP与PLL相同吗? 请告诉我。 提前致谢。 祖宾。 以上来自于谷歌翻译 以下为原文 hi, i was using the xilinx V5 XC5VSX50T board and i had to change the DCM freq on the fly. i looked up online and the documentation said that we can use a drp module (dynamic reconfiguration port) to change the multiply/divide values of the DCM. i wanted to know if this DRP module is an IP core or a xilinx primitive? how can i instantiate it in my design? Do i have to add it via the IP wizard or some other way to incorporate it into my desgin? and is the DCM DRP the same as PLL? please do let me know. thanks in advance. Zubin. |
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1个回答
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DRP是DCM或PLL的一部分。
通常,如果您使用时钟向导,则需要 指定您希望将DRP的信号带到设计中。 使用DRP不是 非常简单,因为每个参数的位通常分散在许多单词中 DRP接口。 当我使用它时,我通常使用完整设置制作时钟向导 对于我想要的每个配置,然后读取DRP中的所有值并将其存储 更改设置时使用。 - Gabor 以上来自于谷歌翻译 以下为原文 The DRP is part of the DCM or PLL. Normally if you use the clocking wizard, you would need to specify that you want the signals for the DRP brought out to the design. Using the DRP is not very simple because the bits for each parameter are often scattered among many words at the DRP interface. When I have used it, I generally made clock wizards with complete settings for each configuration I wanted, then read all the values from the DRP and stored them for use when changing settings. -- Gabor |
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