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你好,
最近在使用adi公司的dds芯片ad9910的DRG扫频模式时有点疑问,请指教,非常感谢了。 设置参数如下: 使用外部25m的时钟,内部倍频40倍,故系统的内部时钟为1000Mhz,设置为DRG的扫频模式工作,起始频率设为100m,截止频率设为200m,POSItiVE STEP SIZE设为10m,positive (+Δ t) slope step intervals设为4ns(最小值,想实现快速扫频) 请问这个positive (+Δ t) slope step intervals(此变量在0x0d寄存器的Digital ramp positive slope rate部分设置)是什么意思呢? 如果按照上述参数开始扫频,是先输出100m,100m信号持续4ns,再输出110m吗,100m的周期为10ns,如果这样的话100m信号不能输出一个完整的周期就开始输出110m信号了,是这样吗? 是不是需要将positive (+Δ t) slope step intervals参数至少设为10ns,才能保证上述扫频信号100m、110m、120 m…..200M,共11点的频率均输出1个周期以上时间的信号? |
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3个回答
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ad9910设置参数如下: 使用外部25m的时钟,内部倍频40倍,故系统的内部时钟为1000Mhz,设置为DRG的扫频模式工作,起始频率设为100m,截止频率设为200m,POSITIVE STEP SIZE设为10m,positive (+Δ t) slope step intervals设为4ns(最小值,想实现快速扫频) 结果是: 扫频开始后起始频率100mhz的信号只保持了4ns(100mhz周期是10ns,并不是一个完整的周期),是吗,然后110mhz信号也保持4ns,以此类推,对吗? |
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aa499962383 发表于 2019-3-1 08:29 正确。 Yiming |
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