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用一个压控振荡器加pll锁相环电路就可以产生倍频，高频可以直接用电感和电容谐振在几倍频上，一般2到3倍频
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利用非线性电路产生高次谐波或者利用频率控制回路都可以构成倍频器。倍频器也可由一个压控振荡器和控制环路构成。它的控制电路产生一控制电压，使压控振荡器的振荡频率严格地锁定在输入频率 f1的倍乘值f0=nf1上
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倍频可以弄个锁相环电路，比如用CD4046这类器件
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倍频可以用锁相环，可灵活调整倍频数
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用FPGA内部的PLL来实现，可以实现输出时钟是输入时钟的n/m倍数关系，其中n和m可以是1~256之间的整数。当然任意关系无法实现，一个是FPGA本身的性能限制，第二，PLL的实现也有最小频率间隔，比这个基数更小的频率差也是无法实现的。
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可以使用傅立叶法，将方波输入正弦平方交换器，再进行谐波选择（一般是用带通滤波器），最后输出放大，可得到需要的倍频
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可以先测量 信号的频率，再输出一个倍频的
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可以使用4060做一个硬件 倍频电路，但是会有延时的，
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倍频就只能通过锁相环实现了，你如果不想这么麻烦就直接选用高频有源晶振来代替。
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