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什么是SP3器件系列缓慢背后的技术原因？
以上来自于谷歌翻译 以下为原文 What would be the technical reason behind slowness of the SP3 device family? 
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3个回答
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感谢你的回答。
我的查询涉及“设计级别的CMOS级别变化是什么影响了Sp3设备上IP的运行速度？V4上的相同IP以更快的速率运行，而在SP3上我们有操作频率的限制”。 我想了解这种差异。 以上来自于谷歌翻译 以下为原文 Thanks for the answer. My query was related to "What is the CMOS level change at design level which affects the operating speed of the IP's on Sp3 devices? The same IP on V4 runs at faster rate and on SP3 we have limitation of frequency of operation". I would like to understand this difference. |
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晶体管级设计细节不向公众发布。
您可以查看静态时序报告（或来自speedprint的输出）以查看与设计原语相关的相应延迟。 BT 以上来自于谷歌翻译 以下为原文 The transistor-level design details are not released to the public. You can view the static timing report (or output from speedprint) to see the respective delays associated with design primitives. bt |
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在每个产品开发中，都必须进行权衡以实现产品的主要目标。
Virtex系列的主要目标是高密度和高速度，为了实现这些成本更高且功耗更高。 Spartan系列的主要目标是低成本和低功耗，为了实现这些，密度更低，速度更低。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com 以上来自于谷歌翻译 以下为原文 In every product development there are tradeoffs that have to be made to achieve the primary objectives of the product. The Virtex family prime objectives are high density and high speed, in order to achieve these the cost is higher and the power consumption is higher. The Spartan family prime objectives are low cost and low power, in order to achieve these the density is lower and the speed is lower.------Have you tried typing your question into Google? If not you should before posting. Too many results? Try adding site:www.xilinx.com |
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只有小组成员才能发言，加入小组>>
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