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你好,
我发现PSOC 4的SWD引脚不能被配置为GPIO,尽管这个选项是存在的。为了配置一个SWD PIN作为GPIO,我们应该将零写入寄存器端口的各个字节,3个PSOC 4.HSIOM寄存器的HSIOM寄存器是一个32位寄存器,并且有一个HSIOM寄存器。对应于每个端口。HsioMaPosixSel3对应于端口3。每个端口最多有8个引脚,每个引脚最多可以有16个配置。因此,端口的每个引脚需要4位(1字节)来自HSIOM寄存器。因此,寄存器的32位可以配置端口的8个引脚。有关详细信息,请通过PSOC 4寄存器TRM的HSIOM寄存器。 谢谢, 思索 以上来自于百度翻译 以下为原文 Hi, I found that the SWD pins of PSoC 4 cannot be configured as GPIO though this option is present. To configure a SWD pin to function as GPIO we should write zero to the respective nibble of the register port 3 HSIOM register of PSoC 4. HSIOM register is a 32 bit register and there is one HSIOM register corresponding to each port . HSIOM_PORT_SEL3 corresponds to port 3. Each port has a maximum of 8 pins and each pin can have a maximum of 16 configurations. Hence 4 bits(1 nibble)from HSIOM register is required for each pin of a port. Therefore 32 bits of the register can configure 8 pins of the port. For detailed information kindly go through HSIOM register of PSoC 4 registers TRM. Thanks, Thinkle |
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2个回答
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好建议!
但我不明白。在我的例子中,PIN是这样配置的,它是从时钟驱动的。 有一个相应的位负责ExtCKLK 0x08。但是,这个位只适用于pI6端口0。 但是我有PoP0 Pin 4,这样的比特不存在。我已经编译了这些项目,它正在工作。 但HSIOM的这个引脚是0x0,平均标准配置。 谢谢你的提示。 SEB 以上来自于百度翻译 以下为原文 Good advise! But I don't understand. In my example the pin is configured such, that it's driven from a clock. There is a corresponding bit responsible EXT_CLK 0x08. However this bit is only for Pin6 port0 But I have port0 pin4 where such bit don't exists. I've compiled the projects and it's working. But HSIOM for this pin is 0x0, mean standard configuration. Thanks for hint. Seb |
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我很高兴听到这个消息,因为我很喜欢PoT0。
以上来自于百度翻译 以下为原文 I very happy with that news, because I'm usung port0 |
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