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为了在ACY8C20XX7中尽可能地减少功耗，该设备将重复测量，然后进入休眠模式一段时间。什么硬件可以在睡觉的时候关掉，然后快速接通以进行测量？具体的控制位清除csdplus_stop。也减少了多少力量，有任何问题，下列组件停止功能清除需要延迟或重新初始化：
```StasyNo.No```停止： … M8CX SETBANG0 ；和reg [ amuxcfg ]，~ 0ch；断开内部电容器 和reg [ ` @ instance_name ` _capsense_cr2_reg ]，~ ` @ instance_name ` _cs_cr2_init；禁用预充电开关和断开的钻头 和reg [ ` @ instance_name ` _capsense_cr0_reg ]，~ 08h；禁用csdplus模式 和reg [ ` @ instance_name ` _capsense_cr3_reg ]，~ ` @ instance_name ` _cs_cr3_init；断电和断开的VRef Buffer MOV reg [ ` @ instance_name ` _capsense_prs_cr_reg ]，00h ` @ ctab40 `；禁用PRS 苎麻属 雷特 谢谢 以上来自于百度翻译 以下为原文 In order to reduce power consumption as much as possible in a CY8C20xx7, the device will repeatedly make measurements and then enter sleep mode for a while. What hardware can be switched off while sleeping and then quickly switched on to make measurements? Specifically the control bits cleared in CSDPLUS_Stop. Also how much power is reduced and are there any issues, delays or reinitializations needed for the following components cleared in the stop function: _`@INSTANCE_NAME`_Stop: ..... M8C_SetBank0 ; and reg[AMUXCFG], ~0ch ; Disconnect internal capacitor and reg[`@INSTANCE_NAME`_CapSense_CR2_REG], ~`@INSTANCE_NAME`_CS_CR2_INIT ; Disable precharge switching and disconnect IDAC and reg[`@INSTANCE_NAME`_CapSense_CR0_REG], ~08h ; Disable CSDPLUS mode and reg[`@INSTANCE_NAME`_CapSense_CR3_REG], ~`@INSTANCE_NAME`_CS_CR3_INIT ; Power down and disconnect VRef Buffer mov reg[`@INSTANCE_NAME`_CapSense_PRS_CR_REG], 00h `@CTAB40`; Disable PRS RAM_EPILOGUE RAM_USE_CLASS_1 ret Thanks 
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你有机会看看这个
HTTP://www. CyPress？COM/？RID＝34189 AN7310 问候，Dana。 以上来自于百度翻译 以下为原文 You have had a chance to look at this - http://www.cypress.com/?rID=34189 AN47310 Regards, Dana. |
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那份文件似乎处理不了8C20XX7。相反，它涵盖了相关部分的家庭：cy8c21x23，cy8c21x34，cy8c21x45，cy8c22xxx，cy8c23x33，cy8c24x23a，cy8c24x94，cy8c27x43，cy8c28xxx，cy8c29x66
在任何情况下，什么样的模拟组件可以关机再开机不影响CapSense？我预料的模拟块引用将被重置，但对于模拟输出缓冲器和CT / SC积木吗？同时，他们之间的延迟是供电和使用它们所需要的时间？在我读过的任何文件中都没有提到这一点。 谢谢 以上来自于百度翻译 以下为原文 That document doesn't seem to handle the CY8C20xx7. Instead it covers Associated Part Family: CY8C21x23, CY8C21x34, CY8C21x45, CY8C22xxx, CY8C23x33, CY8C24x23A, CY8C24x94, CY8C27x43, CY8C28xxx, CY8C29x66 In any case, what analog components can be powered down then powered up without affecting capsense? I'd expected the analog block references would be reset, but what about the analog output buffers and CT/SC blocks? Also, what time delay is needed between powering them up and using them? This isn't mentioned in any of the documents I've read. Thanks |
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我包含了DOC链接，因为20XX7部分是相同的基本技术。
我也找不到回答你的问题的答案，甚至TRM也很薄。 家庭。 我认为你应该归案。 在柏树创建一个技术案例 CyPress网站 “支持” “技术支持” “创造一个案例” 你必须先在赛普拉斯网站上注册。 问候，Dana。 以上来自于百度翻译 以下为原文 I included the doc link because the 20xx7 parts are of same basic technology. I also cannot find answers that cover your questions, Even the TRM is very "thin" on this family. I think you should file CASE - To create a technical case at Cypress - www.cypress.com “Support” “Technical Support” “Create a Case” You have to be registered on Cypress web site first. Regards, Dana. |
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