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请问我能从PLL，DCM或级联PLL DCM获得多大的输出频率限制？

1692 寄存器 DCM

问答对人有帮助，内容完整，我也想知道答案 0 大家好，我正在尝试实现一个可以处理内部高时钟频率的serdes，即。 1.2 GHz，当处于DDR模式时，我到目前为止所做的是将DCM输入时钟连接到25 MHz晶振时钟并将其乘以8以获得连接到DDR寄存器的200 MHz时钟，我试图使用时钟向导获得超过900 MHz的单端但没有帮助我的问题是我能从PLL，DCM或级联PLL DCM获得多大的输出频率限制？，甚至可以从PLL或DCM获得1.2 GHz？我将衷心感谢您的帮助问候， Morlerm 0
2019-8-2 06:10:13　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × asd008 该类别下有 32 个回答。邀请回答 aaaa321 该类别下有 27 个回答。邀请回答 doublelove 该类别下有 26 个回答。邀请回答 vynywrwr 该类别下有 21 个回答。邀请回答 hgjhgd 该类别下有 19 个回答。邀请回答 bwerwer 该类别下有 18 个回答。邀请回答 hanyan533 该类别下有 18 个回答。邀请回答 Jaionm 该类别下有 18 个回答。邀请回答 wang2222222 该类别下有 17 个回答。邀请回答 handsomelchcpp 该类别下有 17 个回答。邀请回答 binro 该类别下有 16 个回答。邀请回答 ningee 该类别下有 16 个回答。邀请回答 wznnzw 该类别下有 15 个回答。邀请回答 myf888 该类别下有 15 个回答。邀请回答 zcy615 该类别下有 14 个回答。邀请回答 wanglinhua2627 该类别下有 14 个回答。邀请回答 guotong1984 该类别下有 14 个回答。邀请回答 yhxc 该类别下有 14 个回答。邀请回答 armortech 该类别下有 14 个回答。邀请回答 60user25 该类别下有 14 个回答。邀请回答举报刘浩相关推荐 • Spartan 6级联DCM / PLL的视频时钟抖动性能是多少？ 2109 • DCM和PLL上的源或系统如何同步 987 • DCM输出时钟约束的示例 3569 • FPGA设计运行从49.875切换到41.56 MHz时PLL或DCM会产生主时钟 1015 • 为什么DCM会限制输出频率？ 906 • 求CycloneIV内置PLL和Spartan 6内置DCM的jitter值. 3852 • Spartan 6 DCM LOCKED没有输出时钟 2554 • 请问Virtex-5通过DRP动态重新配置DCM？ 1006 • DCM DRP并在运行时重新配置DCM freq 3392 • 我的FSM需要重置吗？ 1106 5个回答

答案对人有帮助，有参考价值 0 男，在Spartan 6中，无法实现如此高速的通用IO（请参见数据手册）。 Spartan 6确实有高速收发器（专用模块）用于此目的。我认为达到这种性能水平至少需要一个7系列设备（查看这些数据表）。 Austin Lesea主要工程师Xilinx San Jose 在原帖中查看解决方案

2019-8-2 06:28:07 评论举报潘晶燕

答案对人有帮助，有参考价值 0 男，在Spartan 6中，无法实现如此高速的通用IO（请参见数据手册）。 Spartan 6确实有高速收发器（专用模块）用于此目的。我认为达到这种性能水平至少需要一个7系列设备（查看这些数据表）。 Austin Lesea主要工程师Xilinx San Jose

2019-8-2 06:35:07 评论举报潘晶燕

答案对人有帮助，有参考价值 0 谢谢奥斯汀

2019-8-2 06:46:01 评论举报冯敬宇

答案对人有帮助，有参考价值 0 很抱歉再次打扰你，但我确实在数据表中搜索了DCM（spartan6）的最大输出频率，但是找不到它你是否有一个文件可以看到谢谢，

2019-8-2 07:01:12 评论举报冯敬宇

答案对人有帮助，有参考价值 0 None

2019-8-2 07:12:53 评论举报潘晶燕

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