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我需要能够产生由24位字组成的数据流,它们之间没有间距。为了实现这一点,我使用一个移位寄存器-我正在写我的数据到它的FIFO,然后使电路加载先进的数据到移位寄存器(见示意图)。
默认情况下,FIFO的大小为4(即,我可以加载到24位字,它们将从移位寄存器中产生)。如果我尝试从FIFO中加载更多的东西,而不是放在那里,垃圾就出来了。然而,改变FIFO的大小(通过改变α定义的HIFIFTRGY1FIFOSIG大小4U ISHIVETROGG1.1.H)似乎不改变FIFO的大小。这是怎么回事?如果不是通过修改定义,我如何改变FIFO的大小?在组件配置提示符中没有地方可以做,而且我还没有找到代码中的任何其他地方。 PNSO-PNG 62.1 K |
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