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问候语
PSOC Creator版本为3.3 SP2 SPIM组件版本2.5 我试图使用一个SPIM主组件在CY8C34 46AXI099运行@ 5V。 PSoCoMSI映射到端口0.1，SCLK映射到端口0.3。这两个引脚设置为电阻拉随着目标设备运行@ 3.3V。奴隶可以容忍5V输入。 SPIM组件被设置为内部时钟@ 1000 KbPs（甚至更小到100kbps）。 问题： 在作用域上，SCLK似乎没有足够的时钟来显示MOSI数据。MOSI显示快速转换，SCLK显示非常低频率的斜坡。 诊断 将MOSI输出连接到SCLK引脚上的示意图确认输出驱动器是好的，并且MOSI信号在两个引脚0.1和0.3上被正确地重复。 交换MOSI和SCLK引脚，以便什么是MOSI现在是SCLK，反之亦然，困倦SCLK引脚的问题转移到MOSI引脚。 这表明我的实现或SPIM组件都有一些错误。SCLK似乎并没有走出困境。 有人能帮我理解我做错了什么吗？如果这已经被纠正了，链接到答案将是有益的。 当做 杰森 
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8个回答
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这是我自己设计的板连接到一个3.5“TFT从TiNelCDCo最初，我有设置端口端口@电阻拉，以便保持3.3V TFT高兴。然而，这导致电容效应。将引脚设置为强似乎至少有信号到TFT。不过，我试图找出什么是防止TFT从理解SPI信号，因为我可以看到一些闪烁在TFT与初始化命令被发送。
所有的SPIM信号现在都清楚了，虽然PSoC侧是5V，TFT侧是3.3V。制造商说TFT对其信号具有5V的耐受性，我知道它是这样的，因为我有相同的TFT从NuvoTon CM0设备上运行。 有人知道如何改变SPIM-SCLK输出的宽度吗？我怀疑我在这里看到了一些时间问题，想找到答案。 当做 杰森 |
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迄今为止，SPI所发现的大多数问题都是由SS线引起的问题，一旦FIFO空了，SS线就被带到非活动状态。
我建议您尝试使用自己的SS PIN，当事务结束时使用PixWrad（状态）结束时，设置在事务AD开始时； 鲍勃 |
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鲍勃
谢谢你看一看。是的，我知道这些CS冲突。不过，我已经尝试了所有的排列可能在该引脚，包括没有硬件连接。不知何故，连接到GLCDHCS的SPIMSS似乎产生了一些暗示，命令正在通过LCD。 顺便说一句：GLCDYRST是LCD复位，BL是背光（在信令中没有多大意义） “在更改CS之前，通过读取SpimeRead TxStaseUs（）来检查它。 我得试试看。也许，你可能在这里有东西。 当做 杰森 |
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嗨，鲍伯
我已经能够确定问题的源头。SPIM模块似乎有问题。 比特运行与CPU运行@ 48 MHz的作品。这是在将引脚的驱动模式改变为电阻式引线之后。 连接SPIM模块，没有你提到的冲突，仍然不让LCD工作。所以，它是SPIM模块。 是否有另一种实现SPI主机功能的方法？我只需要MOSI和CLK输出。移位寄存器看起来像是一个可能的候选者，但是，只有在移位时，我才不得不将CLK输入到输出。 当做 杰森 |
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我又回来了。这一次有了更新。
结果表明，SPIM模块与CPU速度和SPIM时钟速度有一定的交互作用。 下面的代码段工作如图所示 空隙SPIXTXDATA（UTI8DAT）{SPIMGWRITETXDATA（DAT）；而（0＝=（SPIMULATEXTXSTATUSSUE）和；SPIMUSTSTYTXXFIFOHEMPTYTYTHOLY移位）；}移除第二行似乎混淆了模块。我注意到的是数据包的聚束。大多数时候，我碰巧看到的是16B数据而不是8B。 用CyDelayus（10）替换第二行似乎也起作用。状态检查的唯一原因是做一些有价值的事情，而不仅仅是一个简单的延迟。然而，与检查相关的延迟似乎工作得很好。 以较低的内部时钟速度运行模块涉及改变此延迟量以使其再次工作。 可能是什么问题？？ 当做 杰森 |
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我刚刚遇到了一些问题，一个7段4位数字模块与SPI接口。
解决这个问题有两个步骤。 第一：自己的SS线处理 第二：每次事务后的延迟（当SS已经很高）时（这是您的解决方案）允许SS行在两个事务之间变高。原始SS线耦合到FIFO空，在不等待的情况下发送多个事务时不会发生。 鲍勃 |
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