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任何人 ？
我们已经使用转换为.svf的.jed编程了我们的芯片。 问题是我们使用vhdl代码丢失了我们计算机上的所有数据，并且我们将代码大约6个月，因此我们忘记了大部分内容。 既然你可以使用项目导航器组装它并创建一个.jed文件，有没有办法反汇编它创建.vhd和.ucf文件？ 谢谢你的帮助 |
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我们使用影响恢复了.jed文件
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我无法获取JED文件并转换回设计源。
------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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只有小组成员才能发言，加入小组>>
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Spartan 3-AN时钟和VHDL让ISE合成时出现错误该怎么办？
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如何在RTL或xilinx spartan fpga的约束文件中插入1.56ns延迟缓冲区？
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有输入，但是LVDS_25的FPGA内部接收不到数据，为什么？
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请问vc707的电源线是如何连接的，我这边可能出现了缺失元件的情况导致无法供电
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求一块XILINX开发板KC705，VC707，KC105和KCU1500
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