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嗨，
我是Zynq的新手（过去曾做过一些spartan-3）并且遇到过一个必须发生的问题，但我找不到任何关于这个主题的内容。 我设法在EMIO接口上获得UART0信号，并将RXD和TXD连接到IO引脚。 现在我想添加RTS / CTS并向EMIO添加“调制解调器”线路。 但这包括所有调制解调器线路，而不仅仅是RTS / CTS。 如果我只是将RTS / CTS分配给引脚并保留其他引脚，我会在比特流生成过程中出错： 错误：[Drc 23-20]规则违规（NSTD-1）未指定的I / O标准 - 138个逻辑端口中的4个...... 错误：[Drc 23-20]规则违规（UCIO-1）无约束逻辑端口 - 138个逻辑端口中的4个...... 如何仅将指定的调制解调器线路连接到EMIO和IO引脚？ 我正在使用MicroZed板和Vivado 2014.2 问候， 燕姿 
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5个回答
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嗨，
如您所知，您只使用调制解调器的RTS / CTS，您可以使用以下命令将此错误减少为警告 set_property SEVERITY {警告} [get_drc_checks NSTD-1] set_property SEVERITY {警告} [get_drc_checks UCIO-1] 这通常不推荐，但在您的情况下，这不会导致任何问题 希望这可以帮助 谢谢 Shreyas -------------------------------------------------- --------------------------------------------尝试搜索你的答案 在发布新主题之前，在论坛或xilinx用户指南中发布问题。 请注意 - 如果提供的信息解决了您的问题，请将答案标记为“接受为解决方案”。给予您认为有帮助且回复导向的帖子给予荣誉（左侧提供的星标）.---------- -------------------------------------------------- ---------------------------------- -------------------------------------------------- --------------------------------------------尝试搜索你的答案 在发布新帖子之前在论坛或xilinx用户指南中发出问题。请注意 - 如果提供的信息解决了您的问题，请将答案标记为“接受为解决方案”。给予您认为有用的帖子给予荣誉（右边提供的星号） 并回复.---------------------------------------------- ------------------------------------------------ |
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>这通常不推荐，但在您的情况下，这不会导致任何问题
这是不正确的。 当没有明确地为IO分配位置和IOSTANDARD时，它可能在板级产生问题，这就是存在该DRC的原因。 每个I / O都需要进行适当的约束，以确保功能正常的设计。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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好的，所以只是忽略错误不是一个好选择。
该解决方案的另一个问题是它将所有类型的错误转换为警告，而不仅仅是关于预期信号的错误。 但是，是否有其他解决方案只使用部分调制解调器线路？ 我是否可以通过PS块将它们从“总线”中取出并将它们连接到PL中？ 我该怎么办？ SPI也出现了同样的问题。 如果路由到EMIO，它包括三个SS信号，我只需要一个去一个引脚。 |
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只有小组成员才能发言，加入小组>>
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