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你好，
我正在使用Aurora 8B / 10B v5.3 IP内核，Virtex 5 FPGA用于使用SFP电缆的GB收发器。 我使用核心生成器创建了IP核，获得了示例设计（所有文件）。 我模拟了示例设计Testbench文件，得到了正确的结果。 现在，在将实例设计实现到virtex 5板之后，我应该创建* .cdc文件来分析板上的输出。 在示例设计文件中删除，没有* .cdc文件。 如果我使用chipscope withput * .cdc文件进行分析，没有触发端口，也没有结果。 ！ 
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3个回答
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您可以在生成核心时启用“使用Chipscope Pro Analyzer”选项，如下面的快照所示。
这将使芯片内窥镜逻辑能够连接所需的Aurora内核控制/状态信号/端口。 如果未启用此选项，则应生成cdc文件并手动添加所需信号。 请注意，您无法在chipcope插件流中驱动端口（如重置）。 你需要VIO核心才能做到这一点; 如果在核心生成期间启用“使用Chipscope Pro Analyzer”选项，则会在设计中进行实例化。 -------------------------------------------------- ---------------------------------------------请将帖子标记为 如果提供的信息能够回答您的问题/解决您的问题，请“接受为解决方案”。给予您认为有用的帖子。 在原帖中查看解决方案 |
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是的，你需要在chipcope中创建CDC文件调试siganls
检查这些链接 http://www.xilinx.com/support/documentation/sw_manuals/xilinx14_7/chipscope_pro_sw_cores_ug029.pdf www.xilinx.com％2Ftraining％2Fdownloads％2Fchipscope-PRO-软件overview.pptx＆安培; EI = DWrlVfivFYq4uATv67ngAg＆安培; USG = AFQjCNGHUxQ0XLUGsdAir4TYol4v-CRCAQ＆安培; SIG2 = F5Tw6ryiGNDJBurc1PtQ4w＆安培; CAD = RJA 谢谢和RegardsBalkrishan ----------------------------------------------- ---------------------------------------------请将帖子标记为 一个答案“接受为解决方案”，以防它有助于解决您的查询。如果一个帖子引导到解决方案，请给予赞誉。 |
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您可以在生成核心时启用“使用Chipscope Pro Analyzer”选项，如下面的快照所示。
这将使芯片内窥镜逻辑能够连接所需的Aurora内核控制/状态信号/端口。 如果未启用此选项，则应生成cdc文件并手动添加所需信号。 请注意，您无法在chipcope插件流中驱动端口（如重置）。 你需要VIO核心才能做到这一点; 如果在核心生成期间启用“使用Chipscope Pro Analyzer”选项，则会在设计中进行实例化。 -------------------------------------------------- ---------------------------------------------请将帖子标记为 如果提供的信息能够回答您的问题/解决您的问题，请“接受为解决方案”。给予您认为有用的帖子。 |
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