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请问使用TMDS的3.3 V VCCIO HR LVDS它是否受Xilinx的支持？

1928 TMDS

问答对人有帮助，内容完整，我也想知道答案 0 你好作为Xilinx分销商的安富利应该了解Xilinx设备吗？ http://zedboard.org/sites/default/files/documentations/AES-ZED-LCD-INT-SCH-V1.pdf 在Avnet的这款产品中，TMDS输出用于产生LVDS信号，使用50R上拉至1.5V这是Xilinx 7系列HR I / O Bank的有效输出模式吗？ 0
2020-7-30 10:57:29　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × asd008 该类别下有 32 个回答。邀请回答 aaaa321 该类别下有 27 个回答。邀请回答 doublelove 该类别下有 26 个回答。邀请回答 vynywrwr 该类别下有 21 个回答。邀请回答 hgjhgd 该类别下有 19 个回答。邀请回答 bwerwer 该类别下有 18 个回答。邀请回答 hanyan533 该类别下有 18 个回答。邀请回答 Jaionm 该类别下有 18 个回答。邀请回答 wang2222222 该类别下有 17 个回答。邀请回答 handsomelchcpp 该类别下有 17 个回答。邀请回答 binro 该类别下有 16 个回答。邀请回答 ningee 该类别下有 16 个回答。邀请回答 myf888 该类别下有 15 个回答。邀请回答 wznnzw 该类别下有 15 个回答。邀请回答 zcy615 该类别下有 14 个回答。邀请回答 wanglinhua2627 该类别下有 14 个回答。邀请回答 guotong1984 该类别下有 14 个回答。邀请回答 yhxc 该类别下有 14 个回答。邀请回答 armortech 该类别下有 14 个回答。邀请回答 60user25 该类别下有 14 个回答。邀请回答举报刘欢相关推荐 • 请问不同的IO级标准信号可以在xilinx spartan6-45t FPGA的同一个BANK中一起分配吗？ 2687 • 可以直接将时钟缓冲器的输出连接到HR库吗？ 2235 • 当Vcco为1.8V时，是否可以产生输出差分时钟/数据？ 2204 • 如何使用DIFF？ 1460 • 请问LVDS数据在HR库中是否能正常工作？ 1410 • 求FPGA 7系列的内部或外部端接？ 3336 • 请问FMC支持的最大单端时钟频率是多少？ 2932 • 我想将DAC连接到FPGA，可以使用3.3V的Vcco电压吗？ 1542 • Altera cyclone V 芯片可以在同一个BANK 实现既使用LVDS信号又使用1.8V的单端么 6964 • 是否可以使用HDMI在3.3V电源组上使用Kintex-7驱动液晶显示器 1482 2个回答

答案对人有帮助，有参考价值 0 HR bank可配置为1.5V VCCO。您是否看到为此IO银行设置了不同的VCCO？ -------------------------------------------------- ----------------------------别忘了回复，给予kudo并接受为解决方案--------- -------------------------------------------------- -------------------

2020-7-30 11:02:43 评论举报贾佳斌

答案对人有帮助，有参考价值 0 你没有看过我的帖子，这就是Avnet的做法 VCCIO = 3.3V IOSTANDARD = TMDS 上拉至1.5V 输出连接到LVDS输入的人机界面。这是Avnet如何实现Xilinx 7系列支持的方式吗？

2020-7-30 11:18:29 评论举报丁兵溢

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