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除三态门、集电极开路门外，TTL集成电路的 输出端不允许并联使用，如果将几个集电极开路门电路的输出端并联，实现“线与”功能时，应在输出端 与电源之间接人上拉电阻。 多余的输出端应该悬空处理，决不允许直接接到VDD或VSS，否则会产生过大的短路电流而使器件 损坏 。不同逻辑功能的CM0S电路的输出端也不能直接连到一起，否则导通的P沟道MOS场效应管和导通的N沟道 MOS场效应管形成低阻通路，造成电源短路而引起器件损坏。 
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不管是TTL 还是CMOS，输出都不能直接连在一起，当一个输出高电平，另一个输出低电平，就会损坏输出电路。一般只允许输出接输入，因为输入的阻抗很高，不会损坏输出电路。输出允许并接的情况只允许在集电极开路或者漏极开路输出的电路中
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为什么会损坏输出电路呢？是不是三极管的集电极电流过大引起的？还有资料上TTL的输出（惯电流）要比输出（拉电流）大得多，这是为什么呢？看TTL电路好像分析不出来嘛！
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这不是绝对的，很多数字电路的输出并没有限流电阻，这样，一高一低的输出，电流是不能按规格书上的最大电流算的，这属于短路电流。规格书上并没有给出短路电流是多少，很明显，输出不能短路。你直接将输出连接在一起，在一个输出高电平，一个输出低电平的情况下，相当于短路，肯定会损坏电路的。
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