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用POWER LOGIC画原理图时有时要修改电阻或者电容的封装，如果单个修改那是非常耗时。统一修改后你的元件参数全部变为你选的这个元件的参数了，非常郁闷。不知有没同仁遇到同样的问题，以及解决方法！谢谢！
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8个回答
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2013-7-4 16:42:37
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2013-7-4 17:17:37
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学习！！！！！！！！！！！！！！！！！！！！
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这个表示，初学者，同请教
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木有办法，只有在画原理图时就定好封装哦。尤其是电阻电容这些规模庞大的器件，画好了图再改封装的话就是很恼火的事情了哦！
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2013-7-5 13:50:05
评论
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等待中，望高手过来解答，
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参观学习。参观学习。参观学习。
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碰到相同问题，坐等高手出来解决
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