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10个回答
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本帖最后由 uesoft 于 2015-4-15 22:36 编辑
verilog,vhdl应该会被c/c++取代吧，就像汇编被c语言取代一样。比如现在的第2代verilog即system verlog就已经有大量c/c++函数了 |
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uesoft 发表于 2015-4-15 22:31 嗯嗯，是的！！！！！！！！！！！！ |
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2015-4-16 14:20:39
评论
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2015-4-16 14:21:59
评论
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语法上可以借鉴，但是思路还是有很大区别
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FPGA很多时候是并行的，在同一模块内的编程，Verilog有很大的优势吧
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淘汰，呵呵，你想多了……
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一个软件编程语言，一个硬件描述语言
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硬件不要跟软件比较
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hdl就是用来描述门开关的，c语言编译之后的机器码也是描述门开关的，二者本质是一样的。最终大量的fpga芯片将被描述为hdl库，成为c语言的函数库，程序员用c语言即可。其实c语言也不要，直接用matlab建模型即可直接综合。
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想法好新颖，路过赞一个
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