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本帖最后由 泰阳风 于 2015-7-12 21:47 编辑
DXP 版本：AD6.6 7903 关键词： 层次图 duplicate net names 多子图 目前正在画一块包含两个控制通道的电路，采用的是AD6.6 ，采用的是层次图。 层次图中，MCU部分的2个通道分别画在了2个原理图文件中，采用Port方式将 信号印出来，在project option->option中，也将net identifer scope选则了为 hierachical （sheet entry <->port conections）.在对原理图顶层文件进行编译 时未出现问题，但对项目进行编译时，则大量出现duplicate net names wire和duplicate net names bus slice等duplicate net names类型的错误。 出现duplicate 的错误对应的网络编号，为相同功能不同通道的mcu模块中的，按照 正常逻辑，选择hierachical方式进行，netlable都是子图内有效的，但为什么还是会出现欧诺各样类似的错误的呢。。 求教各位，谢谢。 
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8个回答
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这两天查了一下整个层次原理图，分享发现情况如下：
1. 部分出现duplicate net names wire XXX是因为通过port与SheetEntry时，连线上有多个netlabel且不同，就会报一个这样的错误。统一后再编译，可以解决很多此类的错误。 但是依旧还是有60个左右的这样错误，出现在两个不同的子图中，且没有通过port引出，按照逻辑此刻应该是local有效，但还是duplicate的。对于这个的处理，只能是在netlabel上加上通道的名称来规避了，不过这里还是不太理理解为什么会出现这样的情况，但愿高手能帮忙谢绝。 |
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有时候精简版软件也会出乱七八糟的问题，我前几天用精简的09就导入不进封装
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最诡异的地方在于，有些网络报错，有些网络又不报错... 都不知道怎么去解释了。 |
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我也遇到这个问题了，两路驱动对称的，所以就直接用了一样的图。结果就出现这个问题了，好纠结
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多张原理图的标识符作用域的设置问题，随后在Project-》Project options中的Options选项下设置了一下Net Identifier Scope（网络标识符作用范围），由原来的Automatic改为Global就可以啦
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哥们看看我的，也是这个问题，
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亲测！ 我今天也遇到了同样的问题，大量搜索无果，尝试了先将原理图中元器件标号，然后编译，无错误无警告。希望能帮到。我的是AD 09
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