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多种哈希算法的可重构硬件架构设计

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标签：哈希算法(10702)

　　针对现有的哈希算法硬件架构仅实现少量几种算法的问题，设计了一种可实现SM3，MD5，SHA-1以及SHA-2系列共7种哈希算法的可重构IP，以满足同一系统对安全性可选择的需求。通过分析各哈希算法及其运算逻辑的相似性，该设计最大化地重用加法器和寄存器，极大地减少了总的实现面积。此外，该设计灵活可配，可以对内存直接存取。以Altera的Stratix II为FPGA目标器件，其最高频率可达100 MHz，总面积较现有设计减少26. 7%以上，且各算法单位面积吞吐率均优于现有设计。

多种哈希算法的可重构硬件架构设计

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