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allegro快速设置栅格点方法步骤介绍

Cadence Allegro系统互连平台能够跨集成电路、封装和PCB协同设计高性能互连。应用平台的协同设计方法，工程师可以迅速优化I/O缓冲器之间和跨集成电路、封装和PCB的系统互联。该方法能避免硬件返工并降低硬件成本和缩短设计周期。约束驱动的Allegro流程包括高级功能用于设计捕捉、信号完整性和物理实现。由于它还得到Cadence Encounter与Virtuoso平台的支持，Allegro协同设计方法使得高效的设计链协同成为现实。

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allegro快速设置栅格点方法

第一步：

新建文档：xxxxx.txt 写入代码：

setwindow pcb

trapsize 15382

define grid

setwindow form.grid

FORM grid all_etch all_etch_x_grids 5 5 5 5 5

FORM grid all_etch all_etch_y_grids 5 5 5 5 5

FORM grid all_etch all_etch_x_offset 0

FORM grid all_etch all_etch_y_offset 0

FORM grid non_etch non_etch_x_grids 5

FORM grid non_etch non_etch_y_grids 5

FORM grid non_etch non_etch_x_offset 0

FORM grid non_etch non_etch_y_offset 0

FORM grid display YES

FORM grid done

setwindow pcb

第二步：

将txt文档保存为逻辑文件：xxxxx.lgc

第三步：

在env文件中写入调用命令：

alias ~2 replay xxxxx.lgc

第四步：

将xxxxx.lgc文件放入brd文件目录下

第五步：

按Ctrl+2键使用快捷方式实现格点切换

注：

allegro快速设置栅格点方法步骤介绍

上述格点及切换格点快捷键可根据自己习惯任意设置！

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