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基于SOC(system on chip)技术，利用VHDL 语言设计开发具有奇偶校
验功能、数据位和波特率可调的通用异步串行通信接口IP 核。该IP 核内置异步
接收和发送模块，可直接提供给其它SOC 系统设计者使用，减少SOC 系统设计的
工作量。
关键字： SOC VHDL 奇偶校验 波特率可调
SOC 的核心思想是IP 核复用,IP 核是设计者提供的具有特定功能和相关参数
描述的模块。为了加快SOC 芯片的设计速度，可将己有的专用IP 核在SOC 设计
中调用，从而简化设计，减少工作量。本文介绍利用VHDL 语言开发一个可复
用的通用异步串行通信接口IP 核。该IP 核内置控制寄存器，通过写入控制字节
设定UART 具体工作模式（设定波特率、选择有效数据位数以及是否采用奇偶
校验位），增加该IP 核的通用性和可移植性。
验功能、数据位和波特率可调的通用异步串行通信接口IP 核。该IP 核内置异步
接收和发送模块，可直接提供给其它SOC 系统设计者使用，减少SOC 系统设计的
工作量。
关键字： SOC VHDL 奇偶校验 波特率可调
SOC 的核心思想是IP 核复用,IP 核是设计者提供的具有特定功能和相关参数
描述的模块。为了加快SOC 芯片的设计速度，可将己有的专用IP 核在SOC 设计
中调用，从而简化设计，减少工作量。本文介绍利用VHDL 语言开发一个可复
用的通用异步串行通信接口IP 核。该IP 核内置控制寄存器，通过写入控制字节
设定UART 具体工作模式（设定波特率、选择有效数据位数以及是否采用奇偶
校验位），增加该IP 核的通用性和可移植性。
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