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The CoolRunner-II
CPLDis a highly unif
orm family of fast, low-power devices. Theunderlying archi
tecture is a tr
adi
tional CPLD architecture, combining macrocells intofunction blocks interconnected with a global routing matrix, the Xilinx
AdvancedInterconnect Matrix (
AIM). The function blocks use a PLA configuration that allowsall product te
rmsto be routed and shared among any of the macrocells of the functionblock.
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