DS2155, DS21Q55, DS2156 Progra

Abstract: This application note provides a detai led description for using the SLC-96 multiframe in the DS2155, DS21Q55, and DS2156. Register values and an example flowchart for software routines allow the user to quickly implement SLC-96 into the application.

Introduction

This application note applies to the following products.

T1/E1 SCTs

DS2155

DS21Q55

DS2156

In a SLC-96-based transmission scheme, the standard Fs-bit pattern is robbed to make room for a set of message fields. The SLC-96 multiframe is made up of six D4 superframes, so it is 72 frames long. In the 72-frame SLC-96 multiframe, 36 of the framing bits are the normal Ft pattern and the other 36 bits are divided into alarm, maintenance, spoiler, and concentrator bits, as well as 12 bits of the normal Fs pattern. Please see the Bellcore document TR-TSY-000008 for more details about SLC-96.

Receive-Side SLC-96 Applications

To enable the DS2155 or DS21Q55 to synchronize onto a SLC-96 pattern, the following configuration should be used:

- Set to D4 framing mode T1RCR2.6 = 0

- Set to cross-couple Ft and Fs bits T1RCR1.3 = 1

- Set to minimum sync time T1RCR1.2 = 0

The user has the option to either extract the SLC-96 message fields from the on-board RFDL register or via the external RLINK pin. The information is always available at both locations. If the user wishes to extract the message bits via the RLINK pin, then some hardware must be added to decode the bits. The SLC-96 message bits can be extracted via the RFDL register without any additional hardware, and it is this method that this application note addresses.

Figure 1 describes the method used to extract the SLC-96 message bits. The DS2155, DS21Q55, and DS2156 contain an on-board SLC-96 synchronizer that is enabled when the T1RCR2.4 bit is set to one. In this mode, the match flag (SR8.1) takes on a new meaning; it will indicate when the framer has received the 12-bit Fs pattern that exists in SLC-96 multiframe. In each SLC-96 multiframe, the user will read the RFDL register three times. The external controller will wait for the match flag to be set. Once set, the controller will then wait for the RFDL to fill.

Figure 1. SLC-96 message field extraction via RFDL.

Table 1 details how the SLC-96 fields will be represented in the RFDL register on each read. Since the RFDL is also used in the ESF framing mode, the zero destuffer should be disabled (T1RCR2.3). (Note: The match registers (RFDLM1 and RFDLM2) are not used in SLC-96 mode and can be programmed with any value.)

Table 1. RFDL register byte sequence.

(MSB) (LSB)

READ #1 C8 C7 C6 C5 C4 C3 C2 C1

READ #2 M2 C1 S = 0 S = 1 S = 0 C11 C10 C9

READ #3 S = 1 S4 S3 S2 S1 A2 A1 M3

Transmit-Side SLC-96 Applications

To insert the SLC-96 message fields, the user has the option to either use the external TLINK pin or to use the on-board TFDL register. Using the TLINK pin requires some external hardware. To enable this option, the T1TCR1.2 bit should be set to one. This application note refers solely to the use of the TFDL register to insert the SLC-96 message fields.

Figure 2 displays the method to enable the DS2155, DS21Q55, or DS2156 to insert the SLC-96 message fields via the TFDL register. On each normal D4 multiframe boundary, the framer signals to the user via the SR4.4 bit to write to the TFDL the sequence of bytes shown in Table 2. The user will write to the TFDL six times in each SLC-96 multiframe.

Figure 2. SLC-96 message field insertion via TFDL.

Table 2. TFDL register byte sequence.

(MSB) (LSB)

Write #1 X X C1 1 1 1 0 0

Write #2 X X C7 C6 C5 C4 C3 C2

Write #3 X X S = 1 S = 0 C11 C10 C9 C8

Write #4 X X A2 A1 M3 M2 M1 S = 0

Write #5 X X 0 S = 1 S4 S3 S2 S1

Write #6 X X 0 1 1 1 0 0

DS2155/DS21Q55/DS2156 Information

For more information about the Dallas Semiconductor's T1/E1 single-chip transceivers, please consult the data sheets available on our website at www.maxim-ic.com/telecom.

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DS21S07AS DS21S07AS - (Maxim Integrated) - 接口 - 信号端接器

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DS21S07AS+T&R DS21S07AS+T&R - (Maxim Integrated) - 接口 - 信号端接器

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DS21T05Z+ DS21T05Z+ - (Maxim Integrated) - 接口 - 信号端接器

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DS21T05Z+T&R DS21T05Z+T&R - (Maxim Integrated) - 接口 - 信号端接器

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DS21T07S+ DS21T07S+ - (Maxim Integrated) - 接口 - 信号端接器

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DS21T07S+T&R DS21T07S+T&R - (Maxim Integrated) - 接口 - 信号端接器

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DS2155GNB+ 接口 - 电信

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DS2155L 接口 - 电信

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DS21Q44T 接口 - 电信

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DS21Q48 接口 - 电信

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DS21Q59LN+ 接口 - 电信

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DS2155LN 接口 - 电信

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DS21Q48B 接口 - 电信

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2023-01-14 19:32:53

DS21Q50L 接口 - 电信

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2023-01-14 19:33:23

DS21Q48NB 接口 - 电信

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2023-01-14 19:33:36

DS21Q348N 接口 - 电信

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2023-01-14 19:34:37

DS21Q55 接口 - 电信

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2023-01-14 19:35:06

DS21Q43-ATN 接口 - 电信

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2023-01-14 19:35:45

DS21Q552 接口 - 电信

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2023-01-14 19:36:12

DS21Q354 接口 - 电信

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2023-01-14 19:36:37

DS21FT42 接口 - 电信

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2023-01-14 19:37:00

DS21FF42 接口 - 电信

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2023-01-14 19:37:53

DS2155G 接口 - 电信

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2023-01-14 19:43:22

DS2155GN 接口 - 电信

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2023-01-14 19:44:02

DS21Q352B 接口 - 电信

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2023-01-14 19:45:42

DS21Q59L 接口 - 电信

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2023-01-14 19:45:53

DS2155L+ 接口 - 电信

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2023-01-14 19:51:28

DS2155LN+ 接口 - 电信

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2023-01-14 19:51:44

DS2156L+ 接口 - 电信

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2023-01-14 19:52:02

DS2156LN+ 接口 - 电信

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2023-01-14 19:52:27

DS21Q354B+ 接口 - 电信

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DS21Q354BN+ 接口 - 电信

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2023-01-14 19:55:41

DS21Q41BT+ 接口 - 电信

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2023-01-14 19:55:55

DS21Q44T+ 接口 - 电信

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2023-01-14 19:56:40

DS21Q552+ 接口 - 电信

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2023-01-14 19:57:27

DS21Q552BN+ 接口 - 电信

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2023-01-14 19:57:37

DS21Q552N+ 接口 - 电信

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2023-01-14 19:57:47

DS21Q554B+ 接口 - 电信

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2023-01-14 19:57:59

DS21Q58L+ 接口 - 电信

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2023-01-14 19:58:21

DS21Q58LN+ 接口 - 电信

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2023-01-14 19:58:50

DS2155G+T&R 接口 - 电信

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2023-01-14 20:11:37

DS2155LC2+ 接口 - 电信

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2023-01-15 18:02:28

DS2155LNB+ 接口 - 电信

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2023-01-15 18:03:06

DS2155LNC2+ 接口 - 电信

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2023-01-15 18:03:36

DS2155GNC2+T&R 接口 - 电信

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2023-01-15 18:09:35

DS21Q50L-W+ 接口 - 电信

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2023-01-15 18:10:01

DS2155GNC2 接口 - 电信

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2023-01-15 18:18:56

DS21Q58L 接口 - 电信

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2023-01-30 18:17:13

DS21Q48A3N 接口 - 电信

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2023-01-30 18:19:01

DS21FF44 接口 - 电信

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2023-01-30 18:20:24

DS21Qx5y BSDL扫描链映射

Q354、DS21Q552、DS21Q554和DS21Q55没有单个BSDL文件，因为它们是多芯片模块，在同一封装中包含四个独立的芯片。

2023-02-07 14:01:05

458

DS2148、DS21348、DS21Q48、DS21Q348和DS21448的附加脉冲幅度设置

　　本应用笔记提供了DS2148/DS21348/DS21Q48/DS213Q48和DS21448的寄存器设置，用于配置发送器的脉冲幅度不同于数据资料中记录的线路构建（LBO）模式。下表列出了寄存器

2023-02-13 15:42:40

583

处理DS2155中的性能报告消息

本应用笔记详细介绍了如何处理DS2155中的性能报告消息（PRM）以及如何处理通过 T1 设施数据链路（FDL）以 HDLC 消息的形式发送或接收 PRM。

2023-02-22 09:41:49

337

已全部加载完成

-	Set to D4 framing mode	T1RCR2.6 = 0
-	Set to cross-couple Ft and Fs bits	T1RCR1.3 = 1
-	Set to minimum sync time	T1RCR1.2 = 0

	(MSB)							(LSB)
READ #1	C8	C7	C6	C5	C4	C3	C2	C1
READ #2	M2	C1	S = 0	S = 1	S = 0	C11	C10	C9
READ #3	S = 1	S4	S3	S2	S1	A2	A1	M3

	(MSB)							(LSB)
Write #1	X	X	C1	1	1	1	0	0
Write #2	X	X	C7	C6	C5	C4	C3	C2
Write #3	X	X	S = 1	S = 0	C11	C10	C9	C8
Write #4	X	X	A2	A1	M3	M2	M1	S = 0
Write #5	X	X	0	S = 1	S4	S3	S2	S1
Write #6	X	X	0	1	1	1	0	0

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